Merge branch 'innovus_ready' into dev
This commit is contained in:
alexmadison
@ -56,19 +56,31 @@ REG_NCA, REG_NCW, REG_M>
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defproc texel_core (avMx1of2<N_IN> in, out;
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Mx1of2<REG_NCW> reg_data[REG_M];
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a1of1 synapses[N_SYN_X * N_SYN_Y];
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a1of1 neurons[N_NRN_X * N_NRN_Y];
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// Dummy synapses and neurons in the handshake blocks
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// should be removed pre-innovus, else they are floating.
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// a1of1 synapses[N_SYN_X * N_SYN_Y];
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// a1of1 neurons[N_NRN_X * N_NRN_Y];
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// Synapse decoder stuff
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// The analogue core and connects to these to replace the above synapses.
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bool! dec_req_x[N_SYN_X], dec_req_y[N_SYN_Y];
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bool? dec_ackB[N_SYN_X];
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a1of1 syn_pu[N_SYN_X];
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// Neuron encoder stuff
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a1of1 enc_inx[N_NRN_X], enc_iny[N_NRN_Y];
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a1of1 nrn_pd_x[N_NRN_X], nrn_pd_y[N_NRN_Y];
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// Monitors and flags to/from core, and selected mon out.
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bool! nrn_mon_x[N_NRN_MON_X], nrn_mon_y[N_NRN_MON_Y];
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bool! syn_mon_x[N_SYN_MON_X], syn_mon_y[N_SYN_MON_Y];
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bool? syn_mon_AMZI[N_SYN_X * N_MON_AMZO_PER_SYN], nrn_mon_AMZI[N_NRN_X * N_MON_AMZO_PER_NRN];
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bool! syn_mon_AMZO[N_MON_AMZO_PER_SYN], nrn_mon_AMZO[N_MON_AMZO_PER_NRN];
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bool! syn_flags_EFO[N_FLAGS_PER_SYN], nrn_flags_EFO[N_FLAGS_PER_NRN];
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// bool? bd_dly_cfg[N_BD_DLY_CFG], bd_dly_cfg2[N_BD_DLY_CFG2];
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// bool? loopback_en;
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power supply;
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bool? reset_B){
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bool? reset_B, reset_reg_B){
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bool _reset_BX;
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BUF_X12 reset_buf(.a = reset_B, .y = _reset_BX, .vdd = supply.vdd, .vss = supply.vss);
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@ -82,7 +94,7 @@ defproc texel_core (avMx1of2<N_IN> in, out;
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// Register
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fifo<N_IN-1,N_BUFFERS> fifo_dmx2reg(.in = _demux.out2, .reset_B = _reset_BX, .supply = supply);
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register_wr_array<REG_NCA, REG_NCW, REG_M> register(.in = fifo_dmx2reg.out, .data = reg_data,
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.supply = supply, .reset_B = _reset_BX);
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.supply = supply, .reset_B = reset_reg_B);
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fifo<N_IN-2,N_BUFFERS> fifo_reg2mrg(.in = register.out, .reset_B = _reset_BX, .supply = supply);
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@ -94,6 +106,9 @@ defproc texel_core (avMx1of2<N_IN> in, out;
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decoder_2d_hybrid<NC_SYN_X, NC_SYN_Y, N_SYN_X, N_SYN_Y, N_SYN_DLY_CFG> decoder(.in = fifo_dmx2dec.out,
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.hs_en = register.data[0].d[0].t, // Defaults to handshake disable
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.ack_disable = register.data[1].d[2].t, // Defaults to ack enabled
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.out_req_x = dec_req_x, .out_req_y = dec_req_y,
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.to_pu = syn_pu,
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.in_ackB_decoder = dec_ackB,
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.supply = supply, .reset_B = _reset_BX);
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INV_X1 dly_cfg_inverters[N_SYN_DLY_CFG];
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(i:N_SYN_DLY_CFG:
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@ -104,28 +119,28 @@ defproc texel_core (avMx1of2<N_IN> in, out;
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)
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// Synapse handshake circuits, to be removed for innovus
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decoder_2d_synapse_hs<N_SYN_X, N_SYN_Y> _synapses(
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.synapses = synapses,
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.in_req_x = decoder.out_req_x, .in_req_y = decoder.out_req_y,
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.to_pu = decoder.to_pu,
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// .in_ackB_pullups = decoder.out_ackB_pullups,
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// .out_req_x_pullups = decoder.in_req_x_pullups,
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.out_ackB_decoder = decoder.in_ackB_decoder,
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.supply = supply);
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// decoder_2d_synapse_hs<N_SYN_X, N_SYN_Y> _synapses(
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// .synapses = synapses,
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// .in_req_x = dec_req_x, .in_req_y = dec_req_y,
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// .to_pu = syn_pu,
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// .out_ackB_decoder = dec_ackB,
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// .supply = supply);
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// Neurons + encoder
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pint NC_NRN;
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NC_NRN = NC_NRN_X + NC_NRN_Y;
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encoder2d_simple<NC_NRN_X, NC_NRN_Y, N_NRN_X, N_NRN_Y, N_LINE_PD_DLY> encoder(
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.reset_B = _reset_BX, .supply = supply);
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.inx = enc_inx, .iny = enc_iny,
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.reset_B = _reset_BX, .supply = supply,
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.to_pd_x = nrn_pd_x, .to_pd_y = nrn_pd_y);
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fifo<NC_NRN, N_BUFFERS> fifo_enc2mrg(.in = encoder.out,
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.reset_B = _reset_BX, .supply = supply);
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// Neuron handshake circuits, to be removed for innovus
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nrn_hs_2d_array<N_NRN_X,N_NRN_Y> nrn_grid(.in = neurons,
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.outx = encoder.inx, .outy = encoder.iny,
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.to_pd_x = encoder.to_pd_x, .to_pd_y = encoder.to_pd_y,
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.supply = supply, .reset_B = _reset_BX);
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// nrn_hs_2d_array<N_NRN_X,N_NRN_Y> nrn_grid(.in = neurons,
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// .outx = enc_inx, .outy = enc_iny,
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// .to_pd_x = nrn_pd_x, .to_pd_y = nrn_pd_y,
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// .supply = supply, .reset_B = _reset_BX);
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@ -271,8 +286,8 @@ REG_NCA, REG_NCW, REG_M>
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defproc texel_singlecore (bd<N_IN> in, out;
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Mx1of2<REG_NCW> reg_data[REG_M];
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a1of1 synapses[N_SYN_X * N_SYN_Y];
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a1of1 neurons[N_NRN_X * N_NRN_Y];
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// a1of1 synapses[N_SYN_X * N_SYN_Y];
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// a1of1 neurons[N_NRN_X * N_NRN_Y];
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bool! nrn_mon_x[N_NRN_MON_X], nrn_mon_y[N_NRN_MON_Y];
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bool! syn_mon_x[N_SYN_MON_X], syn_mon_y[N_SYN_MON_Y];
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@ -309,8 +324,8 @@ defproc texel_singlecore (bd<N_IN> in, out;
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texel_core<N_IN,N_NRN_X, N_NRN_Y, N_SYN_X, N_SYN_Y,NC_NRN_X, NC_NRN_Y, NC_SYN_X, NC_SYN_Y,N_SYN_DLY_CFG,N_NRN_MON_X, N_NRN_MON_Y, N_SYN_MON_X, N_SYN_MON_Y,N_MON_AMZO_PER_SYN, N_MON_AMZO_PER_NRN,N_FLAGS_PER_SYN, N_FLAGS_PER_NRN,N_BUFFERS,N_LINE_PD_DLY, REG_NCA, REG_NCW, REG_M>
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core(.in = fifo_fork2core.out,
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.reg_data = reg_data,
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.synapses = synapses,
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.neurons = neurons,
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// .synapses = synapses,
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// .neurons = neurons,
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.nrn_mon_x = nrn_mon_x, .nrn_mon_y = nrn_mon_y,
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.syn_mon_x = syn_mon_x, .syn_mon_y = syn_mon_y,
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.syn_mon_AMZI = syn_mon_AMZI, .nrn_mon_AMZI = nrn_mon_AMZI,
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@ -355,9 +370,17 @@ REG_NCA, REG_NCW, REG_M>
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defproc texel_dualcore (bd<N_IN> in, out;
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Mx1of2<REG_NCW> c1_reg_data[REG_M];
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a1of1 c1_synapses[N_SYN_X * N_SYN_Y];
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a1of1 c1_neurons[N_NRN_X * N_NRN_Y];
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// a1of1 c1_synapses[N_SYN_X * N_SYN_Y];
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// a1of1 c1_neurons[N_NRN_X * N_NRN_Y];
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bool! c1_dec_req_x[N_SYN_X], c1_dec_req_y[N_SYN_Y];
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bool? c1_dec_ackB[N_SYN_X];
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a1of1 c1_syn_pu[N_SYN_X];
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a1of1 c1_enc_inx[N_NRN_X], c1_enc_iny[N_NRN_Y];
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a1of1 c1_nrn_pd_x[N_NRN_X], c1_nrn_pd_y[N_NRN_Y];
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bool! c1_nrn_mon_x[N_NRN_MON_X], c1_nrn_mon_y[N_NRN_MON_Y];
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bool! c1_syn_mon_x[N_SYN_MON_X], c1_syn_mon_y[N_SYN_MON_Y];
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||||
bool? c1_syn_mon_AMZI[N_SYN_X * N_MON_AMZO_PER_SYN], c1_nrn_mon_AMZI[N_NRN_X * N_MON_AMZO_PER_NRN];
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@ -365,9 +388,17 @@ defproc texel_dualcore (bd<N_IN> in, out;
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bool! c1_syn_flags_EFO[N_FLAGS_PER_SYN], c1_nrn_flags_EFO[N_FLAGS_PER_NRN];
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Mx1of2<REG_NCW> c2_reg_data[REG_M];
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a1of1 c2_synapses[N_SYN_X * N_SYN_Y];
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a1of1 c2_neurons[N_NRN_X * N_NRN_Y];
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// a1of1 c2_synapses[N_SYN_X * N_SYN_Y];
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// a1of1 c2_neurons[N_NRN_X * N_NRN_Y];
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bool! c2_dec_req_x[N_SYN_X], c2_dec_req_y[N_SYN_Y];
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bool? c2_dec_ackB[N_SYN_X];
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a1of1 c2_syn_pu[N_SYN_X];
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a1of1 c2_enc_inx[N_NRN_X], c2_enc_iny[N_NRN_Y];
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||||
a1of1 c2_nrn_pd_x[N_NRN_X], c2_nrn_pd_y[N_NRN_Y];
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bool! c2_nrn_mon_x[N_NRN_MON_X], c2_nrn_mon_y[N_NRN_MON_Y];
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||||
bool! c2_syn_mon_x[N_SYN_MON_X], c2_syn_mon_y[N_SYN_MON_Y];
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||||
bool? c2_syn_mon_AMZI[N_SYN_X * N_MON_AMZO_PER_SYN], c2_nrn_mon_AMZI[N_NRN_X * N_MON_AMZO_PER_NRN];
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@ -377,7 +408,7 @@ defproc texel_dualcore (bd<N_IN> in, out;
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bool? bd_dly_cfg[N_BD_DLY_CFG], bd_dly_cfg2[N_BD_DLY_CFG2];
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bool? loopback_en;
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power supply;
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bool? reset_B){
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bool? reset_B, reset_reg_B){
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// Reset buffers
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bool _reset_BX;
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@ -407,15 +438,23 @@ defproc texel_dualcore (bd<N_IN> in, out;
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core1(.in = fifo_dmx2core1.out,
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.reg_data = c1_reg_data,
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.synapses = c1_synapses,
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.neurons = c1_neurons,
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// .synapses = c1_synapses,
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// .neurons = c1_neurons,
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.dec_req_x = c1_dec_req_x, .dec_req_y = c1_dec_req_y,
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.dec_ackB = c1_dec_ackB,
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.syn_pu = c1_syn_pu,
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.enc_inx = c1_enc_inx, .enc_iny = c1_enc_iny,
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.nrn_pd_x = c1_nrn_pd_x, .nrn_pd_y = c1_nrn_pd_y,
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||||
.nrn_mon_x = c1_nrn_mon_x, .nrn_mon_y = c1_nrn_mon_y,
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||||
.syn_mon_x = c1_syn_mon_x, .syn_mon_y = c1_syn_mon_y,
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||||
.syn_mon_AMZI = c1_syn_mon_AMZI, .nrn_mon_AMZI = c1_nrn_mon_AMZI,
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||||
.syn_mon_AMZO = c1_syn_mon_AMZO, .nrn_mon_AMZO = c1_nrn_mon_AMZO,
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||||
.syn_flags_EFO = c1_syn_flags_EFO, .nrn_flags_EFO = c1_nrn_flags_EFO,
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.reset_B = _reset_BX,
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.reset_B = _reset_BX, .reset_reg_B = reset_reg_B,
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.supply = supply
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);
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@ -424,15 +463,23 @@ defproc texel_dualcore (bd<N_IN> in, out;
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core2(.in = fifo_dmx2core2.out,
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.reg_data = c2_reg_data,
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.synapses = c2_synapses,
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.neurons = c2_neurons,
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// .synapses = c2_synapses,
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// .neurons = c2_neurons,
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.dec_req_x = c2_dec_req_x, .dec_req_y = c2_dec_req_y,
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.dec_ackB = c2_dec_ackB,
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.syn_pu = c2_syn_pu,
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||||
.enc_inx = c2_enc_inx, .enc_iny = c2_enc_iny,
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||||
.nrn_pd_x = c2_nrn_pd_x, .nrn_pd_y = c2_nrn_pd_y,
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||||
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||||
.nrn_mon_x = c2_nrn_mon_x, .nrn_mon_y = c2_nrn_mon_y,
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||||
.syn_mon_x = c2_syn_mon_x, .syn_mon_y = c2_syn_mon_y,
|
||||
.syn_mon_AMZI = c2_syn_mon_AMZI, .nrn_mon_AMZI = c2_nrn_mon_AMZI,
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||||
.syn_mon_AMZO = c2_syn_mon_AMZO, .nrn_mon_AMZO = c2_nrn_mon_AMZO,
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||||
.syn_flags_EFO = c2_syn_flags_EFO, .nrn_flags_EFO = c2_nrn_flags_EFO,
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||||
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||||
.reset_B = _reset_BX,
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||||
.reset_B = _reset_BX, .reset_reg_B = reset_reg_B,
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||||
.supply = supply
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);
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